数字时钟课程设计报告讲解

课程设计报告学生姓名:学号:院:学:级班:题目数字时钟职称:指导教师:1目录?一.设计任务和要求...............................................1?1.1设计要求....................................................1?二.设计原理及框图...............................................1?2.1设计原理....................................................1?2.2设计原理框图................................................1?三.器件说明.....................................................2?3.1器件名称....................................................2?四.设计过程.....................................................8?4.1程序分部解析.................................................8?4.2总设计图...................................................13?五.仿真调试过程................................................14?5.1电路测试与仿真..............................................14?5.2仿真过程中的困难及方案......................................14?六.心得体会....................................................15?七.参考文献....................................................162第1章设计要求1.1设计要求:1.1.1稳定的显示时、分、秒。(要求二十四小时为一个计时周期)1.1.2当电路发生走时误差时,要求电路有校时功能。1.1.3电路有整点报时功能。报时声响为四低一高,最后一响高音正好为整点。第2章设计原理及框图2.1设计原理数字时钟由振荡器、分频器、计数器、译码显示、报时等电路组成。其中,振荡器和分频器组成标准秒信号发生器,直接决定计时系统的精度。由不同进制的计数器、译码器和显示器组成计时系统。将标准秒信号送入采用六十进制的“秒计数器”,每累计六十秒就发生一个“分脉冲”信号,该信号将作为“分计数器”的时钟脉冲。“分计数器”也采用六十进制计数器,每累计六十分,发生一个“时脉冲”信号,该信号将被送到“时计数器”。“时计数器”采用二十四进制,可实现对一天二十四小时的累计。译码显示电路将“时”、“分”、“秒”计数器的输出状态通过六位七段译码显示器显示出来,可进行整点报时,计时出现误差时,可以用校时电路校时、校分。2.2设计原理框图3时显示秒显示分显示秒计时时计时分计时校分控制电校时控制电报分晶振器件说明第3章3.1器件名称数量:六个3.1.174160NU1真值表74160N143QAA134QBB125QCC116QDDQQQENPENTCLKABCDQLOADCLRDACB715RCOENP10ENT90000~LOAD***0*****1~CLR2CLKABCD↑*****10*74160N计数****↑111143.1.2数码管显示器U1DCD_HEX、共阳极型六位七段译码器来显示2数码显示管有两种类型:1、共阴极型时、分、秒,同时当出现误差时,通过它的显示,可以用校时电路校时,校分。数量:二个3.1.374192NU1315QAA21QBB610QCC79QDD1113~LOAD~BO1412CLR~CO5UP4DOWN74LS192N真值表74192N5ABCDCLRUPDOWNQQQQLOADDBCA0ABCD0******0↑11减计数****1↑0加计数1****00001*******7400N数量:三个3.1.4与非门U1A74LS00N7400N真值表OUTAB001011110011NOT数量:六个3.1.5非门U1A7404N7404N真值表OUTA10610.或门数量:一个3.1.6U1A74ALS32N74ALS32N真值表OUTAB0001011101113.1.7与门数量:一个U1A74ALS08N真值表74ALS08OUTBA7000001010111脉冲3.1.8100HZ5VV1100Hz5V0U1A数量:二个四引脚或非门3.1.94002BD_5V8真值表4002BD-5VABCDOUT000010001000100001100100001010011000111010000100101010010110110001101011100111107第4章设计过程4.1程序分部解析4.1.1分、秒程序解析(六十进制)秒计数器和分计数器各由一个十进制计数器(个位)和一个六进制计数器(十位)串接组成,形成两个六十进制计数器,其中个位计数器接成十进制形式。十位计数器选择QB与QC端做反馈端,经与非门输出至控制清零端CLR,接成六进制计数形式(计数至0110时清零)。个位与十位计数器之间采用同步级联复位方式,将个位计数器的进位输出端RCO接至十位计数器的时钟信号输入端CLK,完成个位对十位计数器的进位控制。将十位计...

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